{"product_id":"sn7420-dual-4-input-nand-gate","title":"SN7420 Dual 4-Input NAND Gate","description":"\u003ch3\u003e\u003cspan\u003eSN7420 Dual 4-Input NAND Gate IC – DIP-14\u003c\/span\u003e\u003c\/h3\u003e\n\u003cp\u003e\u003cspan\u003eThe \u003c\/span\u003e\u003cstrong\u003e\u003cspan\u003eSN7420\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e is a digital logic integrated circuit featuring two independent 4-input NAND gates in a single 14-pin DIP package. Part of the 7400-series TTL logic family, it is designed for digital circuit development, logic control, switching applications, and educational electronics projects.\u003c\/span\u003e\u003c\/p\u003e\n\u003cp\u003e\u003cspan\u003eEach NAND gate produces a LOW output only when all four inputs are HIGH. If any input is LOW, the output remains HIGH.\u003c\/span\u003e\u003c\/p\u003e\n\u003cp\u003e\u003cspan\u003eThe SN7420 is suitable for breadboard prototyping, logic circuit experiments, and digital electronics applications.\u003c\/span\u003e\u003c\/p\u003e\n\u003ch2\u003e\u003cspan\u003eKey Features\u003c\/span\u003e\u003c\/h2\u003e\n\u003cul\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eDual NAND Gates:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Contains two independent 4-input NAND logic gates.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eTTL Logic:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Part of the standard 7400-series logic family.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003e5V Operation:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Designed for standard 5V digital logic circuits.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003e4 Inputs per Gate:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Supports logic operations involving four independent inputs.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eDIP-14 Package:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Convenient for breadboard prototyping and through-hole PCB assembly.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eDigital Logic Applications:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Suitable for combinational logic, signal control, and logic experiments.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eStandard Logic Function:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Output is LOW only when all four inputs are HIGH.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003c\/ul\u003e\n\u003ch2\u003e\u003cspan\u003eTechnical Specifications\u003c\/span\u003e\u003c\/h2\u003e\n\u003ctable\u003e\n\u003ctbody\u003e\n\u003ctr\u003e\n\u003cth\u003e\u003cspan\u003eParameter\u003c\/span\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cspan\u003eSpecification\u003c\/span\u003e\u003c\/th\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003ePart Number\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eSN7420\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eIC Type\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eDigital Logic IC\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eLogic Family\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e7400 Series TTL\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eLogic Function\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eNAND\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eNumber of Gates\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e2\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eInputs per Gate\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e4\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eTotal Logic Inputs\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e8\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eOperating Voltage\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e4.75–5.25V DC\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eNominal Supply Voltage\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e5V DC\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eLogic Output\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eTTL\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003ePackage Type\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eDIP-14\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eNumber of Pins\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e14\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eMounting Type\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eThrough-Hole\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003eOperating Temperature\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e0°C to +70°C (standard 7420)\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003c\/tbody\u003e\n\u003c\/table\u003e\n\u003ch2\u003e\u003cspan\u003ePin Configuration\u003c\/span\u003e\u003c\/h2\u003e\n\u003ctable\u003e\n\u003ctbody\u003e\n\u003ctr\u003e\n\u003cth\u003e\u003cspan\u003ePin\u003c\/span\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cspan\u003eFunction\u003c\/span\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cspan\u003eDescription\u003c\/span\u003e\u003c\/th\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1A\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 1 Input A\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e2\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1B\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 1 Input B\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e3\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eNC\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eNo Internal Connection\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e4\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1C\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 1 Input C\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e5\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1D\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 1 Input D\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e6\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1Y\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 1 Output\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e7\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGND\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGround\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e8\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e2Y\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 2 Output\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e9\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e2A\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 2 Input A\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e10\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e2B\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 2 Input B\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e11\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eNC\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eNo Internal Connection\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e12\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e2C\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 2 Input C\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e13\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e2D\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eGate 2 Input D\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e14\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eVCC\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e+5V Power Supply\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003c\/tbody\u003e\n\u003c\/table\u003e\n\u003ch2\u003e\u003cspan\u003eNAND Gate Logic Operation\u003c\/span\u003e\u003c\/h2\u003e\n\u003cp\u003e\u003cspan\u003eEach gate performs the following Boolean operation:\u003c\/span\u003e\u003c\/p\u003e\n\u003cp\u003e\u003cstrong\u003e\u003cspan\u003eY = NOT (A × B × C × D)\u003c\/span\u003e\u003c\/strong\u003e\u003c\/p\u003e\n\u003ch3\u003e\u003cspan\u003eTruth Table\u003c\/span\u003e\u003c\/h3\u003e\n\u003ctable\u003e\n\u003ctbody\u003e\n\u003ctr\u003e\n\u003cth\u003e\u003cspan\u003eA\u003c\/span\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cspan\u003eB\u003c\/span\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cspan\u003eC\u003c\/span\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cspan\u003eD\u003c\/span\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cspan\u003eOutput Y\u003c\/span\u003e\u003c\/th\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e0\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eX\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eX\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eX\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e0\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eX\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eX\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e0\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003eX\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e0\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e1\u003c\/span\u003e\u003c\/td\u003e\n\u003ctd\u003e\u003cspan\u003e0\u003c\/span\u003e\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003c\/tbody\u003e\n\u003c\/table\u003e\n\u003cp\u003e\u003cstrong\u003e\u003cspan\u003eX = Don't Care (either 0 or 1)\u003c\/span\u003e\u003c\/strong\u003e\u003c\/p\u003e\n\u003cp\u003e\u003cspan\u003eThe output becomes LOW only when all four inputs are HIGH.\u003c\/span\u003e\u003c\/p\u003e\n\u003ch2\u003e\u003cspan\u003eConnection Example\u003c\/span\u003e\u003c\/h2\u003e\n\u003cp\u003e\u003cspan\u003eTo operate the first NAND gate:\u003c\/span\u003e\u003c\/p\u003e\n\u003col\u003e\n\u003cli\u003e\u003cspan\u003eConnect Pin 14 (VCC) to +5V DC.\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eConnect Pin 7 (GND) to ground.\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eConnect input signals to Pins 1, 2, 4, and 5.\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eRead the output signal from Pin 6.\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eConnect a 100nF decoupling capacitor between VCC and GND near the IC.\u003c\/span\u003e\u003c\/li\u003e\n\u003c\/ol\u003e\n\u003cp\u003e\u003cspan\u003eThe second NAND gate can operate independently using Pins 9, 10, 12, and 13, with its output on Pin 8.\u003c\/span\u003e\u003c\/p\u003e\n\u003ch2\u003e\u003cspan\u003eApplications\u003c\/span\u003e\u003c\/h2\u003e\n\u003cul\u003e\n\u003cli\u003e\u003cspan\u003eDigital Logic Circuit Design\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eElectronic Switching Circuits\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eLogic Gate Experiments\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eEducational Electronics Projects\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eCombinational Logic Systems\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eDigital Signal Control\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eLogic Function Implementation\u003c\/span\u003e\u003c\/li\u003e\n\u003cli\u003e\u003cspan\u003eBreadboard and PCB Prototyping\u003c\/span\u003e\u003c\/li\u003e\n\u003c\/ul\u003e\n\u003ch2\u003e\u003cspan\u003eImportant Notes\u003c\/span\u003e\u003c\/h2\u003e\n\u003cul\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003ePower Supply:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Use a regulated 5V supply within the specified operating range.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eTTL Compatibility:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Standard TTL HIGH-level output voltage is not guaranteed to meet every 5V CMOS input requirement.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eMicrocontroller Compatibility:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Do not connect 5V TTL outputs directly to 3.3V-only GPIO pins without checking electrical compatibility.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eUnused Inputs:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Do not leave unused TTL inputs floating; connect them to a defined logic level.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003ePackage Orientation:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e Identify Pin 1 using the notch or orientation mark before connecting power.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003cli\u003e\n\u003cstrong\u003e\u003cspan\u003eDecoupling:\u003c\/span\u003e\u003c\/strong\u003e\u003cspan\u003e A 100nF capacitor across the supply pins is recommended.\u003c\/span\u003e\n\u003c\/li\u003e\n\u003c\/ul\u003e\n\u003ch2\u003e\u003cspan\u003ePackage Includes\u003c\/span\u003e\u003c\/h2\u003e\n\u003cul\u003e\n\u003cli\u003e\n\u003cp\u003e\u003cspan\u003e1 × SN7420 Dual 4-Input NAND Gate IC (DIP-14)\u003c\/span\u003e\u003c\/p\u003e\n\u003c\/li\u003e\n\u003c\/ul\u003e","brand":"Robot Pi Shop","offers":[{"title":"Default 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